Un verificador maestro es un método de tolerancia a fallas soportado por hardware para sistemas multiprocesador , en el que dos procesadores, denominados maestro y verificador , calculan las mismas funciones en paralelo para aumentar la probabilidad de que el resultado sea exacto. El verificador- CPU está sincronizado a nivel de reloj con el maestro-CPU y procesa los mismos programas que el maestro. Siempre que la CPU maestra genera una salida, la CPU verificadora compara esta salida con su propio cálculo y, en caso de una diferencia, genera una advertencia.
El sistema de verificación maestra generalmente brinda respuestas más precisas al garantizar que la respuesta sea correcta antes de pasarla a la aplicación que solicita que se complete el algoritmo. También permite el manejo de errores si los resultados son inconsistentes. Una recurrencia de discrepancias entre los dos procesadores podría indicar una falla en el software, problemas de hardware o problemas de sincronización entre el reloj, las CPU y / o la memoria del sistema. Sin embargo, tal procesamiento redundante desperdicia tiempo y energía. Si la CPU maestra es correcta el 95% o más de las veces, se desperdicia la energía y el tiempo utilizados por la CPU correctora para verificar las respuestas. Dependiendo del mérito de una respuesta correcta, una CPU correctora puede estar justificada o no. Para aliviar parte del costo en estas situaciones, la CPU-verificador se puede usar para calcular algo más en el mismo algoritmo,aumentando la velocidad y la salida de procesamiento del sistema de la CPU.
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