El hyperSPARC , cuyo nombre en código es "Pinnacle", es un microprocesador que implementa la arquitectura de conjunto de instrucciones (ISA) SPARC Versión 8 desarrollada por Ross Technology para Cypress Semiconductor .
Información general | |
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Lanzado | 1993 |
Interrumpido | 1996 |
Diseñada por | Tecnología Ross |
Actuación | |
Max. Frecuencia de reloj de la CPU | 40 MHz a 200 MHz |
Arquitectura y clasificación | |
Conjunto de instrucciones | SPARC V8 |
Especificaciones físicas | |
Núcleos |
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El hyperSPARC se introdujo en 1993 y compitió con el SuperSPARC de Sun Microsystems . Raju Vegesna fue el microarquitecto. El hyperSPARC fue el principal competidor de Sun Microsystem a mediados de la década de 1990. Cuando Fujitsu adquirió Ross de Cypress, su nuevo propietario consideró que el hyperSPARC era más importante que el SPARC64 desarrollado por HAL Computer Systems , también una subsidiaria de Fujitsu, opinión que compartió con los analistas.
Descripción
El hyperSPARC era un microprocesador superescalar de dos vías . Tenía cuatro unidades de ejecución: una unidad entera, una unidad de coma flotante, una unidad de carga / almacenamiento y una unidad de sucursal. El hyperSPARC tiene una caché de instrucciones de 8 KB en la matriz, de la cual se obtuvieron y decodificaron dos instrucciones por ciclo. El decodificador no podría decodificar nuevas instrucciones si las instrucciones previamente decodificadas no fueron enviadas a las unidades de ejecución.
El archivo de registro de enteros contenía 136 registros, proporcionando ocho ventanas de registro , una característica definida en la SPARC ISA. Tenía dos puertos de lectura. La unidad entera tenía una canalización de cuatro etapas , de las cuales se agregaron dos etapas para que la canalización fuera igual a todas las canalizaciones que no son de punto flotante. Integer multiplicar y dividir, instrucciones agregadas en la versión V8 de la arquitectura SPARC, tenían una latencia de 18 y 37 ciclos, respectivamente, y detuvieron la tubería hasta que se completaron.
El microprocesador admitía multiprocesamiento en sistemas MBus .
Físico
El hyperSPARC consta de 1,2 millones de transistores. Fue fabricado por Cypress en su proceso de semiconductor de óxido de metal complementario (CMOS) de dos capas de metal de 0,65 µm . Las iteraciones posteriores de hyperSPARC tienen más transistores debido a las nuevas características y fueron trasladadas a procesos más nuevos. Fueron fabricados por Fujitsu , a excepción de la última versión, que fue fabricada por NEC .
embalaje
El hyperSPARC tenía un diseño de varios chips. Estaba empaquetado en un módulo de múltiples chips de cerámica (MCM) con una matriz de cuadrícula de pines (PGA).
Conjuntos de chips
El hyperSPARC utilizó el conjunto de chips Cypress SparcSet que se introdujo a finales de julio de 1992. Fue desarrollado por la empresa emergente de Santa Clara, California, Nimbus Technologies, Inc. para Cypress, quien fabricó el diseño. SparcSet también era compatible con otros microprocesadores SPARC.
Referencias
- Levine, Bernard (11 de abril de 1994). "Los defensores de MCM atraen a los posibles usuarios" . Noticias electrónicas .
- Holden, Daniel (15 de febrero de 1993). "Cypress, Sun: hipertensión HyperSPARC" . Noticias electrónicas .
- Holden, Daniel (15 de marzo de 1993). "HyperSparc ojos unión con Intel en el procesador P6" . Noticias electrónicas .
- Holden, Daniel (19 de abril de 1993). "HyperSPARC lento con Sun Micro" . Noticias electrónicas .
- Shen, John Paul y Lipasti, Mikko H. (2004). Diseño de procesador moderno . Profesional de McGraw-Hill.
Otras lecturas
- "Ross presenta el diseño de Pinnacle SPARC". (25 de marzo de 1992). Informe del microprocesador , vol. 6, no. 4.
- "TI y Cypress / Ross Batalla por el liderazgo de SPARC". (27 de mayo de 1992). Informe del microprocesador , vol. 6, no. 7.
- "Ross finalmente envía HyperSPARC". (15 de noviembre de 1993). Informe del microprocesador , vol. 7, no. 15.
- "HyperSparc mejorado desafía a UltraSparc". (4 de diciembre de 1995). Informe del microprocesador , vol. 9, no. dieciséis.